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TMS320C6748固定/浮点DSP
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SPRS590A - 2009年6月 - 修订2009年8月
1 TMS320C6748固定/浮点DSP
1.1特性
300 - MHz的C674x DSP的VLIW
C674x指令集特点
- 中的C67x的超集+ ™与C64x + ™国际审计准则
- 一千八分之二千四C674x MIPS / MFLOPS
- 字节寻址( 8位/ 16位/ 32位/ 64位数据)
- 8位溢出保护
- 位字段提取,设置,清除
- 标准化,饱和度,位计数
•紧凑型16位指令
C674x二级缓存内存架构
- 32K字节L1P程序RAM /高速缓存
- 32K字节L1D数据RAM /高速缓存
- 256K字节L2统一映射RAM /高速缓存
- 灵活的RAM /高速缓存分区( L1和L2)
- 1024K字节的引导ROM
增强型直接存储器存取控制器3
( EDMA3 ) :
- 2通道控制器
- 3转移控制器
- 64个独立的DMA通道
- 16快速DMA通道
- 可编程的突发传输大小
的TMS320C674x浮点VLIW DSP核心
- 负载存储架构,不结盟
支持
- 64个通用寄存器( 32位)
- 六ALU ( 32 / 40位)功能单元
支持32位整数, SP ( IEEE单
精密/ 32位)和DP ( IEEE双
精密/ 64位)浮点数
最多支持四个SP附加每
时钟,四个DP附加每2
最多支持两个浮点( SP
或DP )倒数逼近
( RCPxP )和平方根倒数
逼近( RSQRxP )运营
每个周期
- 两个乘法功能单元
混合精度IEEE浮点
乘支持多达:
- 2 SP X SP -> SP每时钟
- 2 SP X SP -> DP每两个时钟
- 2 SP X DP -> DP每三个钟
- 2 DP X DP -> DP每四个钟
定点乘法支持两个32×
32位乘法, 4个16 ×16位
乘法,或者8个8 ×8位乘法
每个时钟周期的,复杂的倍数
- 指令包装减少代码大小
- 所有指令条件
•硬件支持模数回路
手术
•受保护模式运行
- 异常支持错误检测和
程序重定向
软件支持
- TI的DSP / BIOS™
- 芯片支持库和DSP库
128K字节的RAM内存共享
1.8V或3.3V LVCMOS的IO (除USB和
DDR2接口)
两个外部存储器接口:
- EMIFA
NOR ( 8 / 16位宽的数据)
NAND ( 8 / 16位宽的数据)
16位SDRAM ,128 MB地址
空间
- DDR2 /移动DDR内存控制器
16位DDR2 SDRAM ,512 MB
地址空间或
16位SDRAM的mDDR具有256 MB
地址空间
三个可配置16550型UART模块:
- 随着调制解调器控制信号
- 16字节FIFO
- 16倍或13倍过采样方案
LCD控制器
两个串行外设接口( SPI ),每
与多芯片选择
两个多媒体卡( MMC ) /安全数字
( SD)与安全数据卡接口I / O
( SDIO )接口
两个主/从内部集成电路(I
2
C
总线™ )
一台主机端口接口( HPI )在16位宽
多路复用地址/数据总线的高带宽
可编程实时单元子系统
( PRUSS )
- 两个独立的可编程实时
请注意,一个重要的通知有关可用性,标准保修,并在得克萨斯州的关键应用程序使用
仪器的半导体产品和免责条款及其出现在本文档的末尾。
TMS320C6000 , C6000是德州仪器的商标。
产品预览资料涉及产品的
发展形成或设计阶段。特征数据和
其他规格的设计目标。德州仪器储备
有权改变或者恕不另行通知停止这些产品。
版权所有© 2009-2009 ,德州仪器
产品预览
TMS320C6748固定/浮点DSP
SPRS590A - 2009年6月 - 修订2009年8月
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单元( PRU )芯
32位加载/存储RISC架构
每个核心4K字节指令RAM
每核心512字节的数据RAM
PRU子系统( PRUSS )可
通过软件,以节省电源关闭
注册30每PRU的出口
从除该子系统
正常R31输出PRU核心。
- 标准的电源管理机制
时钟门控
下单PSC整个子系统
时钟门控域
- 专用中断控制器
- 专用交换中心资源
USB 1.1 OHCI (主机) ,集成PHY
(USB1)
USB 2.0 OTG端口,集成PHY ( USB0 )
- USB 2.0高速/全速客户端
- USB 2.0高速/全速/低速主机
- 端点0 (控制)
- 终点1,2,3,4 (控制,批量,中断
或ISOC) Rx和Tx
一个多通道音频串行端口:
- 发送/接收时钟高达50 MHz
- 两个时钟区和16个串行数据引脚
•支持TDM , I2S ,以及类似的格式
- DIT-有能力
• FIFO缓冲器,用于发送和接收
两个多通道缓冲串行端口:
- 发送/接收时钟高达50 MHz
- 两个时钟区和16个串行数据引脚
•支持TDM , I2S ,以及类似的格式
- AC97音频编解码器接口
- 电信接口( ST总线, H100 )
- 128通道TDM
• FIFO缓冲器,用于发送和接收
10/100 Mb / s以太网MAC ( EMAC ) :
- 符合IEEE 802.3标准
- MII媒体独立接口
- RMII简化媒体独立接口
- 管理数据I / O( MDIO )模块
视频端口接口( VPIF ) :
- 2个8位SD ( BT.656 ) ,单通道16 - bit或
单生( 8位/ 10位/ 12位)视频捕捉
频道
- 2个8位SD ( BT.656 ) ,单通道16 - bit视频
显示通道
通用并行端口( UPP ) :
- 高速并行接口FPGA和
数据转换器
- 数据宽度在2个通道为8
到16位包
- 单倍数据速率或双数据速率
转帐
- 支持与启动多个接口,
ENABLE和等待控制
串行ATA(SATA )控制器:
- 支持SATA I( 1.5 Gbps)的和SATA II
( 3.0 Gbps)的
- 支持所有的SATA电源管理
特点
- 硬件辅助的本地命令
排队( NCQ)达32项
- 支持端口倍增器和
基于命令的交换
实时时钟采用32 kHz振荡器和
独立的电源导轨
3个64位通用定时器
(可配置为两个32位定时器)
其中64位通用定时器(观看
DOG )
两个增强型脉宽调制器
( eHRPWM ) :
•专用的16位时基计数器,
周期和频率控制
- 6单边, 6双边对称或3
双重边缘不对称输出
- 死区产生
- PWM斩波由高频载波
- 旅行区输入
3个32位增强型捕捉模块
( ECAP ) :
- 可配置为3捕捉输入或3
辅助脉冲宽度调制器( APWM )
输出
- 多达四个事件单次捕获
时间邮票
361球无铅塑料球栅阵列
( PBGA ) [郑商所后缀] , 0.65毫米间距球
361球无铅塑料球栅阵列
( PBGA ) [ ZWT后缀] , 0.80毫米间距球
商业或扩展温度
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TMS320C6748固定/浮点DSP
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SPRS590A - 2009年6月 - 修订2009年8月
1.2商标
DSP / BIOS , TMS320C6000 , C6000 , TMS320 , TMS320C62x的,和TMS320C67x是得克萨斯州的商标。
仪器。
所有商标均为其各自所有者的财产。
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TMS320C6748固定/浮点DSP
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1.3说明
该设备是基于一个C674x DSP内核的低功耗应用处理器。它提供了显著
更低的功耗比的DSP的TMS320C6000 ™平台的其他成员。
该设备使OEM和ODM能够快速向市场设备具有强大的操作系统
系统支持,丰富的用户界面,并通过最大限度的高处理性能的生命
一个完全集成的混合处理器解决方案的灵活性。
该装置的DSP核使用一个2级高速缓存的体系结构。 1级程序高速缓存( L1P )是
32KB直接映射的高速缓存和一级数据缓存( L1D )是32KB 2路组相联高速缓存。该
2级程序高速缓存( L2P )由被程序之间共享256KB的内存空间
数据空间。 L2还具有1024KB引导ROM 。 L2存储器可以被配置为映射存储器,高速缓存,
两者的或其组合。虽然在DSP的L2是可访问的其他主机系统中,附加的
128KB RAM的共享内存可用于其他主机使用,而不会影响DSP性能。
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4
外设集包括:一个10/100 Mb / s以太网MAC ( EMAC )与管理数据输入/输出
( MDIO )模块; 1个USB2.0 OTG接口; 1 USB1.1 OHCI接口; 2内部集成电路(I2C)
总线接口; 1多通道音频串行端口(的McASP )与16串行和FIFO缓冲区;两
多通道缓冲串行端口( McBSP的)与FIFO缓冲区;多芯片两个SPI接口
选择; 4个64位通用定时器,可分别配置(一个可配置的看门狗) ;一
可配置的16位主机端口接口( HPI ) ;的16管脚的通用输入/输出多达9银行
( GPIO ),具有可编程中断/事件生成模式,复用等外设;三
UART接口(每个RTS和CTS ) ; 2增强高分辨率脉宽调制器
( eHRPWM )外设;可配置3 32位增强型捕捉( eCAP)模块外设
作为3个捕获输入和3个辅助脉宽调制器( APWM )输出; 2外部存储器
接口:用于较慢存储器的异步与SDRAM的外部存储器接口( EMIFA )或
外围设备,并以较高的速度DDR2 /移动DDR控制器。
以太网媒体访问控制器( EMAC)提供设备和一之间的有效接口
网络。的EMAC支持10Base-T和100BASE-TX ,或10兆比特/秒(Mbps )和100 Mbps
在半双工或全双工模式。另外一个管理数据输入/输出( MDIO)接口是
适用于PHY配置。该EMAC支持MII和RMII接口。
SATA控制器提供了一个高速接口,海量数据存储装置。 SATA控制器
同时支持SATA I( 1.5 Gbps)的和SATA II ( 3.0 Gbps)的。
通用并行端口( UPP)提供一个高速接口,多种类型的数据转换器,
的FPGA或其它并行设备。该UPP支持8之间的可编程的数据宽度为16位的
在每两个信道。单日率和双倍数据传输率支持,以及START ,
ENABLE和WAIT信号以提供控制,适用于各种的数据转换器。
甲视频端口接口( VPIF )被包括提供一个灵活的视频输入/输出端口。
丰富的外设集提供了控制外围设备,并与沟通的能力
外部处理器。对于每个外设的详细信息,请参阅下文文档中的相关章节
以及相关的外设参考指南。
该装置具有一组完整的用于DSP的开发工具。这些措施包括C编译器,一个DSP
汇编优化器来简化编程和调度,并在Windows®调试接口
可见性源代码的执行。
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1.4功能框图
JTAG接口
系统控制
输入
时钟(多个)
锁相环/时钟
发电机
W / OSC
常规 -
用途
定时器( X3 )
RTC /
32-kHz
OSC
C674x™
DSP CPU
AET
32KB
L1基因型Pgm
32KB
L1内存
DSP子系统
电源/睡眠
调节器
256KB的L2内存
1024KB L2 ROM
交换中心资源( SCR)
外设
DMA
音频端口
串行接口
显示
并口
内部存储器
控制定时器
EDMA3
(x2)
的McASP
W / FIFO
McBSP的
(x2)
I
2
C
(x2)
SPI
(x2)
UART
(x3)
液晶显示
CTLR
UPP
128KB
内存
的ePWM
(x2)
ECAP
(x3)
可定制的界面
连接
视频
外部存储器接口
PRU子系统
USB2.0
OTG CTLR
PHY
USB1.1
OHCI CTLR
PHY
EMAC
10/100 MDIO
( MII / RMII )
HPI
MMC / SD
(8b)
(x2)
SATA
VPIF
EMIFA(8b/16B)
NAND /闪存
16B SDRAM
DDR2/MDDR
调节器
图1-1 。功能框图
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